电科17年12月考试《EDA技术》期末大作业答案答案
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17年12月考试《EDA技术》期末大作业-0001
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试卷总分:100 得分:0
一、 单选题 (共 46 道试题,共 92 分)
1.VHDL中信号定义的位置是（ ）。
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A.实体中任何位置
B.实体中特定位置
C.结构体中任何位置
D.结构体中特定位置
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2.传统电路设计思想是______________。
A.自下而上
B.自外而里
C.自上而下
D.自里而外
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3.使用QuartusⅡ工具软件修改设计元件符号，应采用( )方式。
A.图形编辑
B.文本编辑
C.符号编辑
D.波形编辑
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4.VHDL的描述风格有
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A.行为描述、数据流描述和结构描述
B.行为描述、门级描述和数据流描述
C.数据流描述、结构描述和版图描述
D.门级描述、结构描述和版图描述
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5.值为“1110”的标准逻辑矢量，进行sla运算后值为____________ 。
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A.1100
B.1101
C.1110
D.1000
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6.在VHDL中，结构体内部是由（ ）语句组成的。
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A.顺序
B.并行
C.顺序和并行
D.任何
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7.功能仿真是在设计输入完成之后，选择具体器件进行编译之前进行的逻辑功能验证，又称为（ ）。
A.前仿真
B.预仿真
C.预编译
D.后仿真
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8.实体说明中包括端口说明，那么端口的模式可分为以下哪几种
A.in，out
B.in，out，inout
C.in，out，buffer
D.in，out，inout，buffer
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9.进程语句的启动条件是
A.wait语句或敏感信号量
B.wait语句
C.敏感信号量
D.wait语句或且敏感信号量
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10.下列标识符中，（ ）是不合法的标识符。
A.State0
B.9moon
C.Not_Ack_0
D.signal
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11.EAB中RAM的大小可灵活配置，Altera FLEX 10K 系列器件中的EAB作RAM用时，有哪几种配置模式
A.512x8，1024x4，2048x2，4096x1
B.256x8，512x4，1024x2，2048x1
C.256x4，512x2，1024x1
D.256x16，512x8，1024x4，2048x2
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12.VHDL常用的库是
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A.IEEE
B.STD
C.WORK
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D.PACKAGE
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13.变量是局部量，可以写在（ ）。
A.实体中
B.进程中
C.线粒体
D.种子体中
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14.下面哪种语句不是并行语句
A.wait语句
B.process语句
C.块语句
D.生成语句
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15.如果A、B均为为std_logic_vector的数据类型，A的值为“100”，B的值为“011”，则B&A的值为____________。
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A.100011
B.011100
C.110011
D.010011
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16.文本输入方式是指采用（ ）进行电路设计的方式。
A.C
B.硬件描述语言
C.C++
D.JAVA
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17.变量是一种局部量，变量可在以下哪些位置进行定义
A.process、architecture、entity
B.process、function、procedure
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C.function、entity、package
D.entity、package、procedure
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18.FLEX10K 结构中的最小单元是
A.EAB
B.LAB
C.LE
D.CLB
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19.在VHDL中，PROCESS本身是（ ）语句。
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A.顺序
B.顺序和并行
C.并行
D.任何
20.Altera FLEX 10K 系列器件中的EAB大小为______________位。
A.256
B.512
C.1024
D.2048
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21.重载操作符的定义一般见于 IEEE 库的哪几个程序包
A.std_logic_arith、std_logic_unsigned、std_logic_signed
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B.std_logic_arith、std_logic_unsigned、std_logic_1164
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C.std_logic_unsigned、std_logic_1164、std_logic_arith
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D.std_logic_1164、std_logic_arith、std_logic_unsigned、std_logic_signed
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22.下列语句中，不属于并行语句的是（ ）。
A.进程语句
B.CASE语句
C.元件例化语句
D.WHEN…ELSE…语句
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23.在元件例化语句中，用_______符号实现名称映射，将例化元件端口声明语句中的信号与PORT MAP（）中的信号名关联起来。
A.=
B.:=
C.<=
D.=>
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24.在VHDL语言编写的程序中，注释使用（ ）符号。
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A.//
B.--
C.;
D.__
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25.在VHDL中，88_670_551.453_909属于( )文字。
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A.整数
B.以数制基数表示的
C.实数
D.物理量
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26.一个完整结构的结构体由哪两个基本层次组出
A.数据说明和进程
B.结构体说明和结构体功能描述
C.顺序描述语句和并行执行语句
D.结构体例化和结构体赋值
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27.在VHDL的端口声明语句中，用( )声明端口为输入方向。
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A.IN
B.OUT
C.INOUT
D.BUFFER
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28.Altera公司开发的开发软件为
A.Foundation
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B.ispDesignEXPERT
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C.MaxplusⅡ
D.ISE
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29.VHDL文本编辑中编译时出现如下的报错信息Error: VHDL syntax error: signal declaration must have ‘；’，but found begin instead. 其错误原因是（ ）。
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A.信号声明缺少分号。
B.错将设计文件存入了根目录，并将其设定成工程。
C.设计文件的文件名与实体名不一致。
D.程序中缺少关键词。
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30.关于1987标准的VHDL语言中，标识符描述正确的是（ ）。
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A.必须以英文字母开头
B.可以使用汉字开头
C.可以使用数字开头
D.任何字符都可以
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31.符合1987VHDL标准的标识符是
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A.2A
B.A+2
C.A_2
D.22
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32.下列关于元件例化语句的说法正确的是
A.位置关联方式与顺序有关，名称关联方式与顺序有关。
B.位置关联方式与顺序有关，名称关联方式与顺序无关。
C.位置关联方式与顺序无关，名称关联方式与顺序有关。
D.位置关联方式与顺序无关，名称关联方式与顺序无关。
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33.关于数组A的定义如下：signal A：bit_vector(7 downto 0);那么，A=“00110101”，A(6 downto 5)＝_____________。
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A.’00
B.10
C.‘01
D.11
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34.下列关于CASE语句的说法不正确的是
A.条件句中的选择值或标识符所代表的值必须在表达式的取值范围内。
B.CASE语句中必须要有WHEN OTHERS=>NULL；语句。
C.CASE语句中的选择值只能出现一次，且不允许有相同的选择值的条件语句出现。
D.CASE语句执行必须选中，且只能选中所列条件语句中的一条。
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35.用EDA技术进行电子系统设计的目标是最终完成?（ ）的设计与实现。
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A.ASIC
B.FGPA
C.CPLG
D.ASIP
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36.EDA设计流程包括设计准备、（ ）、设计处理和器件编程四个步骤。
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A.总体设计
B.设计输入
C.详细设计
D.设计数据
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37.reg[7:0]?mema[255:0]正确的赋值是（ ）。
A.mema[5]=3'd0
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B.8'd0
C.1'b1
D.mema[5][3:0]=4'd1
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38.VHDL程序基本结构包括
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A.实体、子程序、配置
B.实体、结构体、配置、函数
C.结构体、状态机、程序包和库
D.实体、结构体、程序包和库
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39.可以进行在系统编程的器件是（ ）。
A.EPROM
B.PAL
C.GAL
D.FPGA
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40.下面哪一条命令是MAX+PLUSII在时序仿真时执行加载节点的命令？（ ）。
A.file-> set project to current file
B.assign->pin/location chip
C.node->enter node from SNF
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D.file->create default symbol
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