17秋福师《EDA技术》在线作业二答案答案
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福师《EDA技术》在线作业二
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试卷总分:100 得分:0
一、 多选题 (共 10 道试题,共 20 分)
1. PLD是一种半定制器件，主要包括（）。
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A. FPGA
B. CPLD
C. CPU
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D. ASIC
专业答案:----
满分：2 分
2. 衡量仿真器性能的重要指标有哪些（）。
A. 仿真速度
B. 仿真的准确性
C. 仿真的易用性
满分：2 分
3. 目前常用的硬件描述语言为：（）。
A. Verilog
B. VHDL
专业答案:----
C. 和 VC
D. VB
专业答案:----
满分：2 分
4. 常用的综合工具有哪些（）。
A. FPGA Express
B. FPGA compiler
C. Synplify Pro
满分：2 分
5. 状态机常用的编码方式有（）。
A. 顺序编码
B. 格雷编码
C. 约翰逊编码
D. 一位热码
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满分：2 分
6. IP核一般分为哪几种（）。
A. 硬核
B. 固核
C. 软核
D. 以上全不对
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满分：2 分
7. EDA技术发展阶段描述正确的是（）。
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A. CAD阶段
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B. CAE阶段
C. EDA阶段
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D. 以上都不对
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满分：2 分
8. 下面哪些是专业提供PLD器件厂商（）。
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A. Xilinx
B. Altera
C. Lattice
D. Micsoftware
专业答案:----
满分：2 分
9. TOP-down设计一般分为哪几个层次（）。
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A. 系统级
B. 功能级
C. 门级
D. 开关级
专业答案:----
满分：2 分
10. 常用的集成FPGA/CPLD开发工具有哪些（）。
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A. MAX+plus II
B. Quartus II
C. ISE
D. ispLEVER
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满分：2 分
17秋福师《EDA技术》在线作业二答案标准满分答案
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二、 判断题 (共 40 道试题,共 80 分)1. JTAG是Joint Test Action Group, 联合测试行动组的缩写。
A. 错误
B. 正确
满分：2 分
2. 行为描述就是对设计实体的数学模型的描述，其抽象程度远高于结构描述。
A. 错误
B. 正确
满分：2 分
3. FPGA是Field Programmable Gate Array,现场可编程门阵列的缩写。
正确答案:----
A. 错误
B. 正确
满分：2 分
4. ASIC一般采用全定制方法来实现设计。
A. 错误
B. 正确
满分：2 分
5. Alter的FPGA器件主要由两类配置方式：主动配置方式和被动配置方式。
A. 错误
B. 正确
满分：2 分
6. 如果只需要在上电和系统错误时进行复位操作，采用异步复位方式比同步复位方式好。
A. 错误
B. 正确
满分：2 分
7. PLA是Programmable Logic Array,可编程逻辑阵列的缩写。
A. 错误
B. 正确
满分：2 分
8. 反熔丝型开关元件一般用在对可靠性要求较高的军事和航天产品器件上。
A. 错误
B. 正确
满分：2 分
9. 在IC设计领域中，IP核一般完成某种功能的设计模块。
A. 错误
B. 正确
满分：2 分
10. 解释型仿真器速度慢一些，但可以随时修改仿真环境和仿真条件。
A. 错误
B. 正确
满分：2 分
11. CPLD和FPGA都属于高密度可编程逻辑器件。
专业答案:----
A. 错误
B. 正确
满分：2 分
12. 有限状态机的复位分为两种：同步复位和异步复位。
A. 错误
B. 正确
满分：2 分
13. PLD是一种全定制器件。
专业答案:----
A. 错误
B. 正确
满分：2 分
14. 布局布线为将综合生成的电路逻辑网表映射到具体的目标器件中实现，并产生最终的可下载文件的过程。
A. 错误
B. 正确
满分：2 分
15. GAL是Generic Array Logic,通用阵列逻辑的缩写。
A. 错误
B. 正确
满分：2 分
16. 状态机可以分为：米里型和摩尔型两类。
A. 错误
B. 正确
满分：2 分
17. Verilog HDL中的变量一般分为两种数据类型：net型和variable型。
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A. 错误
B. 正确
满分：2 分
18. HDL是Hardware Description Language,硬件描述语言的缩写。
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A. 错误
B. 正确
满分：2 分
19. Verilog语言的行为描述语句，如条件语句、赋值语句和循环语句类似于软件高级语言，便于学习和使用。
A. 错误
B. 正确
满分：2 分
20. 用状态机进行设计具有速度快、结构简单、可靠性高等优点。
A. 错误
B. 正确
满分：2 分
21. SOC是指把一个完整的系统集成在一个芯片上。
A. 错误
B. 正确
满分：2 分
22. Verilog HDL中整数型常量是不可以综合的。
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A. 错误
B. 正确
满分：2 分
23. 时序仿真也叫后仿真。
A. 错误
B. 正确
满分：2 分
24. Verilog HDL和 VHDL目前还都不是IEEE标准。
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A. 错误
B. 正确
满分：2 分
25. PLD器件的设计往往采用层次化的设计方法，分模块，分层次地进行设计描述。
专业答案:----
A. 错误
B. 正确
满分：2 分
26. Verilog HDL语法要素与软件编程语言（如C语言）是完全相同的。
专业答案:----
A. 错误
B. 正确
满分：2 分
27. 目前常用的硬件描述语言为：Verilog HDL和 VHDL。
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A. 错误
B. 正确
满分：2 分
28. PLD器件内部主要由各种逻辑功能部件和可编程开关构成。
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A. 错误
B. 正确
满分：2 分
29. 把适配后生成的编程文件装入到PLD器件中的过程称为下载。
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A. 错误
B. 正确
满分：2 分
30. IP核中的硬核可靠性高，能确保性能，能够很快投入使用。
A. 错误
B. 正确
满分：2 分
31. Verilog HDL中的常量主要有：整数，实数和字符串
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A. 错误
B. 正确
满分：2 分
32. Verilog HDL中实数型和字符串型常量是可以综合的。
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A. 错误
B. 正确
满分：2 分
33. 混合仿真器就是能同时支持Verilog和VHDL的仿真器。
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A. 错误
B. 正确
满分：2 分
34. SOC是System On Chip,芯片系统的缩写。
A. 错误
B. 正确
满分：2 分
35. ISP和专用的编程器是FPGA常用的两种编程方式。
A. 错误
B. 正确
满分：2 分
36. Verilog HDL支持赋值语句。
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A. 错误
B. 正确
满分：2 分
37. 对设计而言，采用的描述级别越高，设计越容易。
A. 错误
B. 正确
满分：2 分
38. 目前在数字系统的设计中，主要采用Bottom-UP设计为主。
A. 错误
B. 正确
满分：2 分
39. Synplify是一种FPGA/CPLD的逻辑综合工具。
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A. 错误
B. 正确
满分：2 分
40. Verilog HDL数据类型是用来表示数字电路中的物理连线、数据存储和传输单元等物理量的。
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A. 错误
B. 正确
满分：2 分
17秋福师《EDA技术》在线作业二答案历年真题如下：
